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工作内容：
1.参与芯片功能模块的需求分析与 Spec 分解，协助完成 RTL 代码（Verilog/VHDL）编写、模块文档撰写。
2.根据项目需求，完成IP选型。负责数字芯片模块级/系统级电路设计，包括开发design spec, RTL编码（Verilog/VHDL）, design flow check等。
3. 支持验证团队完成验证计划制定、测试用例编写及覆盖率分析，配合debug复杂逻辑问题并做bug fix。
4. 参与综合、形式验证、静态时序分析（STA）等前端流程执行，输出设计文档
5. 配合后端团队提供前端设计数据，参与时序收敛问题定位与优化建议。
6.支持 FPGA 原型验证与硅后测试，记录并反馈逻辑相关问题。
任职要求：
1.本科及以上学历，微电子、电子工程、通信、计算机系统结构等相关专业。
2.掌握数字电路、计算机体系结构核心知识，熟悉 AMBA（AXI/AHB）等总线协议者优先。
3. 熟悉 Verilog 语言，具备扎实 RTL 编码能力，有课程设计或竞赛中的模块设计经历（如 CPU 核、DDR 接口等）优先。
4.了解 ASIC 设计全流程，熟悉至少 |
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